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简介

功能 #23

错误 #11: yzrt_v1 发送打桩无输出

增加维测

由 匿名用户 在 将近 6 年 之前添加. 更新于 超过 5 年 之前.

状态:
已关闭
优先级:
立刻
指派给:
-
开始日期:
2019-08-12
计划完成日期:
% 完成:

90%

预期时间:
问题归属:

描述

使用bar空间及dma传输，使x86可以读写fpga的模块内寄存器。

文件

维测接口方案.vsd (59 KB) 维测接口方案.vsd 匿名用户, 2019-08-12 14:56
维测框架.jpg (34 KB) 维测框架.jpg 匿名用户, 2019-08-12 14:56

历史记录

#1

由 匿名用户 更新于 将近 6 年 之前

  • 状态 从 新建 变更为 进行中
#2

由 匿名用户 更新于 将近 6 年 之前

  • % 完成 从 0 变更为 60
#3

由 匿名用户 更新于 将近 6 年 之前

  • % 完成 从 60 变更为 90

①bar部分及rf_interface的模块模板已经写完
②顶层模块分发控制模块maintain_top已经写完，但是需要修改wr/rd的检测方式（检测上升沿）

#4

由 匿名用户 更新于 将近 6 年 之前

维测已经写完，待验证

#5

由 匿名用户 更新于 超过 5 年 之前

  • 状态 从 进行中 变更为 已解决

维测代码编写并合版本，另起项目进行维测验证。

#6

由 高 峰 更新于 超过 5 年 之前

  • 状态 从 已解决 变更为 已关闭

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