由 杨 晋 在 大约 4 年 之前添加. 更新于 大约 4 年 之前.
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关联到 重复 与其重复 阻挡 被阻挡 优先于 跟随于 复制到 复制于 问题 # 延期: 天 取消
看AD5311手册时序图,应该在时钟的下降沿(或高电平中间位置)取数据, 但FPGA的iic模块在时钟的低电平中间取输入串行数据,会导致取回数据错误。进行UT仿真也看到有个bit读取不对,待修改。
修改iic模块代码并UT测试,读取数据正确,国荣上板测试回读值和写入一致。
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