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简介

错误 #592

大上行问题debug

由 匿名用户 在 将近 4 年 之前添加. 更新于 超过 3 年 之前.

状态:
已解决
优先级:
立刻
指派给:
-
目标版本:
Rel_2.1.6P
开始日期:
2021-07-19
计划完成日期:
% 完成:

0%

预期时间:
问题归属:
FPGA
CPU类型:

描述

现象：可以到随机接入，但是花费时间最长可以到17分钟

调试：
①fpga使用单音+频谱仪零span确认配比
②fpga确认接收功率
③其他再行讨论

文件

大上行0span观察.jpg (133 KB) 大上行0span观察.jpg 匿名用户, 2021-07-19 18:10
大上行0span观察2.jpg (142 KB) 大上行0span观察2.jpg 匿名用户, 2021-07-19 18:10
u-d切换位置.png (34.3 KB) u-d切换位置.png 匿名用户, 2021-07-20 12:29
底噪.png (7.73 KB) 底噪.png 匿名用户, 2021-07-20 12:30
d_u切换位置.png (71.4 KB) d_u切换位置.png 匿名用户, 2021-07-20 12:32
天线0接收幅值.png (2.65 KB) 天线0接收幅值.png 匿名用户, 2021-07-20 12:32
天线1接收幅值.png (18.7 KB) 天线1接收幅值.png 匿名用户, 2021-07-20 12:32

历史记录

#1

由 匿名用户 更新于 将近 4 年 之前

①fpga使用单音+频谱仪零span确认配比
确认配比正常，切换时间计算，周期5ms=10slot,在第2slot切换。计算【下行】占时1ms+0.214ms ≈1.21ms，【上行】占时间=3.5+0.14ms+0.11ms≈3.75ms
见下图：图中周期5ms，下行占据1.15/1.20ms


②fpga确认接收功率
③其他再行讨论

#2

由 匿名用户 更新于 将近 4 年 之前

上行测试结果：
①天线0，接收功率符合之前记录。
实测幅值8650，实测输入功率-45dBm；根据记录幅值25500、功率-36.5dBm,推算输入功率-45.8dBm。

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②天线1，接收功率大于天线0 约3dB
实测幅值12676，实测输入功率-45dBm，推算输入-42.5dBm

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③底噪符合
测试幅值为100左右，记录值为115

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④切换位置符合
d->u, u->d共四个位置， 上行表现符合大上行的位置

#3

由 匿名用户 更新于 将近 4 年 之前

  • 状态 从 进行中 变更为 挂起

最终测试跟终端有关系，有的终端容易接入，有的终端不易接入

#4

由 匿名用户 更新于 超过 3 年 之前

  • 状态 从 挂起 变更为 进行中
#5

由 匿名用户 更新于 超过 3 年 之前

  • 状态 从 进行中 变更为 已解决

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