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一般

简介

功能 #630

功能 #591: 转频电路上板测试

频偏闭环

由 匿名用户 在 超过 3 年 之前添加. 更新于 超过 3 年 之前.

状态:
已解决
优先级:
普通
指派给:
-
类别:
FPGA
开始日期:
2021-08-23
计划完成日期:
% 完成:

100%

预期时间:
问题归属:

描述

将sync-alg计算结果同ps的频偏调整闭环

文件

210823_1s级别调整.png (102 KB) 210823_1s级别调整.png 匿名用户, 2021-08-23 17:43
210823_100ms级别调整.png (135 KB) 210823_100ms级别调整.png 匿名用户, 2021-08-23 17:43
210823_频偏调整抖动.png (86.8 KB) 210823_频偏调整抖动.png 匿名用户, 2021-08-23 17:43
210823_频偏调整3000_100.png (73.7 KB) 210823_频偏调整3000_100.png 匿名用户, 2021-08-23 17:46

历史记录

#1

由 匿名用户 更新于 超过 3 年 之前

经过测试，100ms左右的频偏调整间隔比较合适，即在本次频偏后，间隔100ms，再发出下次大使能进行频偏计算。

抖动幅度约在50Hz。同时钟本身漂移频率接近
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210823_1s级别调整.png

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210823_100ms级别调整.png

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210823_频偏调整3000_100.png

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 210823_频偏调整抖动.png

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