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# 跟踪 状态 问题归属 优先级 主题 指派给 更新于
1335 错误 已解决 DRV, FPGA 普通 STE ARM环境测试690t板卡，FGPA在写fft数据过程中，rq总线ready信号变无效 战 弋戈 2023-10-27 10:12 Actions
1222 需求CR 已解决 DRV 普通 增加一个FHDEMO的初始化流程配置 战 弋戈 2023-08-16 18:04 Actions
1211 错误 已解决 FPGA 普通 CPRI Fh demo测试，fpga把tx包丢弃 杨 晋 2023-07-17 10:57 Actions
1201 任务 新建 DRV 普通 当cu或du或phy崩溃时，增加FPGA日志记录。 战 弋戈 2023-07-06 10:07 Actions
1200 任务 已解决 DRV 普通 对spectral_offset_s 结构体可以进行正负值的设置。 战 弋戈 2023-07-11 11:07 Actions
1196 错误 挂起 DRV, FPGA, PRU 普通 PL eth 通道在进行udp 测试 小于64字节包测试时，会出现丢包现象。 杨 晋 2023-10-24 10:08 Actions
1176 错误 已解决 DRV 普通 新国产平台，编译驱动出现错误。 战 弋戈 2023-07-11 11:08 Actions
1153 错误 挂起 FPGA 低 3ru时，AU合并模块收到第3个ru的数据比第2个ru晚了几个子符号 杨 晋 2023-10-24 10:08 Actions
1152 错误 新建 DRV, FPGA 普通 PL eth 网卡udp报文x86->ps环回测试，当发送的udp报文为1字节时，x86->ps的过程中，ps端没有收到。 杨 晋 2023-06-20 09:49 Actions
1150 错误 已解决 DRV, FPGA 普通 调试eth，RU pl发送的tcp包，X86收到的包尾部有重复字节 杨 晋 2023-06-29 10:08 Actions
1149 错误 已解决 DRV, FPGA 普通 调试eth，RU pl发送的ping，X86收到的长度不正确 杨 晋 2023-06-29 10:08 Actions
1093 错误 已解决 系统 普通 在进行LINUX版本RU移植eth1过程中，裸机程序发送接收能收到数据，linux版本的驱动只能发送不能接收到PL环回的数据。 战 弋戈 2023-05-24 12:24 Actions
1032 错误 新建 FPGA 高 Fh demo跑1588+两RU版本，一段时间后出现没有rx 2023-02-07 18:48 Actions
1027 任务 已解决 DRV 高 MultiRU版本中，根据yang模型的具体配置进行ecpri的绑定设置，在发送1588报文时，根据yang的配置进行设置eport端口。 战 弋戈 2023-05-24 12:28 Actions
837 错误 新建 普通 在正式发布版本中，不管是否启动的RU，都要等待40s，进行优化处理。 2022-05-19 17:41 Actions
827 功能 新建 普通 PRU温度，功率查询 2022-05-19 14:59 Actions
791 错误 挂起 FPGA 普通 FX200 在fpga占用资源高时，eth ip输出时钟频率不对，出现RU连接不上 杨 晋 2023-10-24 10:09 Actions
789 错误 已解决 FPGA 普通 FPGA上电第一次挂，重启站或reboot后再没有问题 杨 晋 2023-06-29 10:09 Actions
788 错误 已解决 DRV 普通 FPGA有的版本偶现驱动读取版本号 全F，有的版本必现这个问题 杨 晋 2023-06-29 10:11 Actions
749 任务 新建 普通 增加时间默认样点配置时，使用配置文件进行设置。 战 弋戈 2021-12-27 15:44 Actions
739 错误 新建 普通 fpga的PS系统，在进行写入flash时， 每次只能写入256字节，不能一次写入更多的数据。 2021-12-14 19:41 Actions
713 任务 新建 普通 [AU] 上行256QAM FEC 杨 晋 2021-11-22 18:16 Actions
712 任务 新建 低 CPRI 接口功能开发 杨 晋 2021-11-22 18:15 Actions
711 任务 新建 DRV, FPGA 普通 [AU/RU] 高精度的时间同步(1588) 杨 晋 2022-07-04 12:08 Actions
710 任务 新建 普通 [AU] 多RU接收数据合并 杨 晋 2021-11-22 18:13 Actions
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