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从 2020-05-26 到 2020-06-24
2020-06-24
- 10:15 错误 #153 (已关闭): FPGA前端处理prach数据问题
- prach数据从FPGA入口抓取时域数据，能够正确解出UE所发送的prach，且FPGA出口数据及PHY收到的数据解出的prach是一致的；
说明FPGA或者x86在数据处理过程中对数据产生了影响，导致检出的preamble ind... - 10:12 错误 #152 (已解决): 上行数据接收offset不对
- 修改Nta offset 从1280 --> 1600
- 10:11 错误 #152 (已关闭): 上行数据接收offset不对
- 上行数据接收Nta offset与协议不符，使得上行接收数据产生了偏移
2020-06-17
- 18:37 错误 #147 (已解决): 日志模块移植合并，L1启动失败
- 18:36 错误 #147: 日志模块移植合并，L1启动失败
- 问题出在log模块自身，flush时使用的buffer的index没有初始化导致。
正确是应该在构造函数loger：：loger时初始化 write_idx = 0;read_idx = 0; - 17:45 错误 #147 (已关闭): 日志模块移植合并，L1启动失败
- 问题出在log模块自身，flush时使用的buffer的index没有初始化导致。
正确是应该在构造函数loger：：loger时初始化 write_idx = 0;read_idx = 0;
2020-06-12
- 19:00 错误 #141 (已解决): sib1检测存在问题
- 问题已经解决
原因：
1、pdsch加扰处理中，rnti类型定义为int16， 但是从dlconfig消息中填写的rnti是uint16, sib1的rnti是65535 ，在加扰处理中，rnti被强转成了-1，导致cinit的计... - 18:57 错误 #141 (已关闭): sib1检测存在问题
- mib可以正常解到，sib1终端没有收到
2020-06-09
- 16:08 错误 #139 (已解决): WLS共享内存使用缺陷
- 解决思路：PDSCH payload的指针地址 需要在DU侧先由VA转成PA，PHY才能够访问该地址，并将PA转成自己进程的VA，进行后续处理。
解决实施：DU侧Tx req 填入payload之前增加 va2pa转换，PHY侧对p... - 16:04 错误 #139 (已关闭): WLS共享内存使用缺陷
- PDSCH payload 分配接口内存后，在DU侧直接将VA虚拟地址填入了接口，PHY无法访问另一个进程的虚拟地址，导致PHY访问该地址即宕机。
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