活动
从 2020-02-20 到 2020-03-20
2020-03-18
- 19:54 WI 功能 #69: V3 射频卡上jesd SYS_REF捕捉不到
- 问题:
按V3的代码流程在检测jesd状态时没法捕捉SYS_REF信号
原因:
待分析
解决:
在检测jesd的时候多循环发送几次SYNC脉冲 - 19:51 WI 功能 #81 (已解决): 2T2R的开始测试时CRC不对
- 19:49 WI 功能 #81 (已关闭): 2T2R的开始测试时CRC不对
- 现象:
每个crc周期收到的数据包数量少于8000个
原因:
2T2R需要的计算算力更高,每个Tx、RX单独绑定到CPU核上 - 12:08 WI 功能 #80 (挂起): 相噪较差
- 现象:fmc9371v2.1的射频板,在2khz的span下,经频谱仪观测,相噪比较差
待解决
2020-03-17
- 17:17 WI 功能 #70 (已解决): V3 射频卡换回crc不正确
- 问题①spi的片选cs切换问题
解决:修改spi模块局部代码解决
问题②mcs failed(multi chip sync)
解决:x86端调整时序解决
问题③CRC错误,收发频点有错位、IQ路数据反移
解决:参... - 15:50 WI 功能 #70 (已关闭): V3 射频卡换回crc不正确
- 16:25 NR 错误 #66 (已关闭): 增加广播,打桩帧号子帧号为0,crc错误
- 16:25 NR 功能 #63 (已关闭): 上行接收数据到16QAM译码完成全流程功能开发及验证
- 16:18 NR 错误 #59: LDPC的译码64QAM错误
- mcs28 250rb可以正确;273rb因为tbsize太大,译码超时了,需要提升译码主频
- 15:49 WI 功能 #69 (已关闭): V3 射频卡上jesd SYS_REF捕捉不到
2020-03-11
- 15:26 NR 错误 #66 (已解决): 增加广播,打桩帧号子帧号为0,crc错误
- 参数配置问题
2020-03-02
- 14:43 NR 功能 #64 (已关闭): 指定RBstart的起始位置非0,crc错误
- 问题修改完成,原因: phy_ul_pusch_de_remap_func 函数中, pReDemapData->RBStart 起始点映射错误,应该置为0
2020-02-28
- 18:46 NR 错误 #65 (已解决): 帧号、子帧号跟随系统,crc错误
- 问题的原因:
1、下行RS的产生和 上行的CE 采用了4G的scramble的算法,会根据slot号,生成DMRS序列。
2、打桩系统,还没有加入同步,发送和接收没有完全的帧号子帧号对应,因此会导致发送和接收 DMRS解错;
... - 18:40 NR 错误 #65 (进行中): 帧号、子帧号跟随系统,crc错误
- 16:29 NR 错误 #65 (已关闭): 帧号、子帧号跟随系统,crc错误
- 1、原来打桩测试的帧号和子帧号为0 ,crc 正确;
2、修改为跟随系统调整,crc错误; - 16:33 NR 功能 #67 (已关闭): UDP发送数据 环回测试数据速率达到850Mbps
- 16:29 NR 错误 #66 (已关闭): 增加广播,打桩帧号子帧号为0,crc错误
- 16:27 NR 功能 #64 (已关闭): 指定RBstart的起始位置非0,crc错误
- 1、rbstart 起始位置为0, crc正确;
2、rbstart 起始位置不是0的时候,crc 全错; - 16:25 NR 错误 #59 (已解决): LDPC的译码64QAM错误
- MCS27以及以下,64QAM 验证已经通过
MCS28 存在问题 - 16:23 NR 错误 #58: 需要验证 x86-->FPGA(FH)... 空口...FPGA(FH RX)后链路是否正确
- 外环测试已经通过, 需要连接馈线,两个天线上需要增加35db的衰减。
- 16:22 NR 功能 #63 (已解决): 上行接收数据到16QAM译码完成全流程功能开发及验证
- zlog 绑定核没有生效,修改zlog代码,已经生效,系统不会因为zlog的等级挂死了。
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