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从 2021-09-21 到 2021-10-20
2021-10-20
- 18:20 错误 #668: FPGA使用FH进行demo测试，概率性出现跑一会接收异常
- 经调测，发现在出现上述接收包变少时，fpga进入dma模块的fft数据包并没有少，且出现无可用描述符的错误标志，说明这个问题与完成标志的上报和dma下发描述符等有关
2021-10-19
- 20:42 错误 #668 (挂起): FPGA使用FH进行demo测试，概率性出现跑一会接收异常
- !rx_dis.png!
现象如上
2021-10-13
- 14:14 STE UT 功能 #649: 【PHY】PBCH Polar 译码模块移植 （UCI）
- 修改了avx512的代码，如下
!代码修改.PNG!
添加了解交织和CRC校验码块
添加了MIB解析的子函数。以上按avx512 PBCH polar译码问题解决。
2021-10-08
- 11:57 错误 #657: AU 上下行功能
- 问题一：sym/slot/cp_infor的x86使用的是156.25m下的配置，
解决：暂时手动写死为122.88m下配置
问题二；au 无slot_tti等中断输出。
分析： 无输出使能信号sfn_set_vali... - 10:43 错误 #657 (已解决): AU 上下行功能
- 问题：无tti输出
2021-09-30
- 10:14 功能 #655 (进行中): 测试环境搭建
- 需求：
基站：9371 au
终端：au+ru
au使用pcie延长线 ： 180°，5cm，软线
基站 IP: 192.168.2.250
终端 IP: 192.168.2.247
终端 IP: 192.1...
2021-09-29
- 14:32 功能 #653 (挂起): AU PPS功能
- 需求：
①FPGA引脚输入pps信号
②AU初始跟pps对齐
③AU运行过程，反馈△t给x86，计算配置auxdac值，实现AU与pps的锁定
2021-09-27
- 11:09 STE UT 功能 #650 (已解决): 【PHY】PBCH polar 译码C代码修改使用AVX2加速
- 译码性能：
使用Matlab toolbox Cell search 作为对比，Free5GRan的软信息输入为matlabAWGN加噪后软信息数据。简单对比，无法准确估计性能。
SNR = 10, 都能译码正确；
SN...
2021-09-24
- 09:48 功能 #651 (已解决): FPGA上下行时偏调整功能
- 需求：
1.1 终端同步调整 ：终端接收调整+发送调整
1.2 终端发射ta调整：终端发送调整，接收不调整
计划：
①设计
②仿真
③在板打桩（视风险可以省略）
④联调
2021-09-23
- 10:00 STE UT 功能 #650 (已解决): 【PHY】PBCH polar 译码C代码修改使用AVX2加速
- 使用指令集修改C代码的polar译码，比对加速后的运行时间，评估可行性
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h2. 指令加速... - 09:55 STE UT 功能 #649 (挂起): 【PHY】PBCH Polar 译码模块移植 （UCI）
- 09:54 STE UT 功能 #649 (挂起): 【PHY】PBCH Polar 译码模块移植 （UCI）
- PBCH polar译码计划复用基站侧UCI译码，解速率匹配与matlab能够比对成功，但译码输出结果比对不成功，继续调试工作量较大，任务挂起。
UT使用C代码的polar译码方案，译码结果比对通过，但译码模块在板运行时间长达1ms...
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