高 峰
- 注册于: 2019-08-06
- 最后登录: 2025-11-03
问题
项目
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- Company Publicity (管理人员, 开发人员, 报告人员, 2019-09-12)
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- 产品硬件设计及装配 (管理人员, 开发人员, 报告人员, 2023-11-15)
- 产品硬件设计 (管理人员, 开发人员, 报告人员, 2023-11-20)
- 研发特性开发 (管理人员, 开发人员, 报告人员, 2024-02-01)
- 清华电子应急通信项目 (管理人员, 开发人员, 报告人员, 2024-02-01)
- 产品3.0平台 (管理人员, 开发人员, 报告人员, 2024-11-28)
- B5G_UE (开发人员, 报告人员, 2025-01-06)
- FirstCall (开发人员, 报告人员, 2024-11-28)
- 核心网产品 (开发人员, 报告人员, 2024-12-03)
- 基站横联 (管理人员, 开发人员, 报告人员, 2025-03-27)
活动
今天
- 16:22 基站横联 错误 #4351 (进行中): 横联功率上报Power值异常
- 16:22 基站横联 错误 #4351: 横联功率上报Power值异常
- 由张倩来合入正式版本吧
- 12:09 基站横联 错误 #4369 (进行中): 【协议栈】2流峰速情况下,PHY接收到的slot config 消息时序异常
- 10:23 基站横联 错误 #4369: 【协议栈】2流峰速情况下,PHY接收到的slot config 消息时序异常
- 出现很多slot cfg下发晚了一个slot的情况;正常应该是提前2个slot,但实际配置下来只提前了1个slot;
但第一条差别有点大,SFN都不一样
LOG_ERROR_S("slot_cfg_req err:%d,%... - 10:15 基站横联 错误 #4369 (进行中): 【协议栈】2流峰速情况下,PHY接收到的slot config 消息时序异常
- 10:56 基站横联 错误 #4366: 横联静态时隙additional Dmrs解不出来问题
- 根因分析:开发静态时隙dmrs 2port的时候引入的;未考虑additional dmrs情况。动态时隙HL也没有问题。
- 10:25 基站横联 错误 #4366 (已解决): 横联静态时隙additional Dmrs解不出来问题
- 已合入主分支,发送端采数已验证;待接收端验证
- 10:38 基站横联 错误 #4282 (已解决): slot10 静态时隙执行后,slot12、14、16、18 CRC错误
- 测试未再出现此问题
- 10:37 基站横联 错误 #4211 (已解决): onestep版本,自同步模式下,静态时隙的TB解不对
2025-10-28
- 18:33 基站横联 错误 #4337 (已解决): 【协议栈】L2 流量波动,因为L2 wireshark FAPI3抓包导致
- L2 取消wireshark FAPI3抓包(包含TB),就不出现此问题;怀疑是与L2 FAPI接收线程性能有关
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